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IDT71V3577S_79S, IDT71V3577SA_79SA, 128K x 36, 256K x 18, 3.3V Synchronous SRAMs with
3.3V I/O, Flow-Through Outputs, Burst Counter, Single Cycle Deselect Commercial and Industrial Temperature Ranges
Pin Configuration – 128K x 36, 165 fBGA
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NC
NC/TDI
NC/TDO
A
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P
R
NC (4)
NC
I/O P3
I/O 17
I/O 19
I/O 21
I/O 23
V SS (1)
I/O 25
I/O 27
I/O 29
I/O 31
I/O P4
NC
LBO
A 7
A 6
NC
I/O 16
I/O 18
I/O 20
I/O 22
NC
I/O 24
I/O 26
I/O 28
I/O 30
NC
(4)
NC (4)
CE 1
CS 0
V DDQ
V DDQ
V DDQ
V DDQ
V DDQ
NC
V DDQ
V DDQ
V DDQ
V DDQ
V DDQ
A 5
A 4
BW 3
BW 4
V SS
V DD
V DD
V DD
V DD
V DD
V DD
V DD
V DD
V DD
V SS
A 2
A 3
BW 2
BW 1
V SS
V SS
V SS
V SS
V SS
V SS
V SS
V SS
V SS
V SS
NC/ TRST (2,5)
(2)
NC/TMS (2)
CS 1
CLK
V SS
V SS
V SS
V SS
V SS
V SS
V SS
V SS
V SS
V SS
NC (4)
A 1
A 0
BWE
GW
V SS
V SS
V SS
V SS
V SS
V SS
V SS
V SS
V SS
V SS
NC
(2)
NC/TCK (2)
ADSC
OE
V SS
V DD
V DD
V DD
V DD
V DD
V DD
V DD
V DD
V DD
V SS
A 10
A 11
ADV
ADSP
V DDQ
V DDQ
V DDQ
V DDQ
V DDQ
NC
V DDQ
V DDQ
V DDQ
V DDQ
V DDQ
A 13
A 12
A 8
A 9
NC
I/O 15
I/O 13
I/O 11
I/O 9
NC
I/O 7
I/O 5
I/O 3
I/O 1
NC
A 14
A 15
NC
NC (4)
I/O P2
I/O 14
I/O 12
I/O 10
I/O 8
ZZ (3)
I/O 6
I/O 4
I/O 2
I/O 0
I/O P1
NC (4)
A 16
6450 tbl 17
Pin Configuration – 256K x 18, 165 fBGA
1
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NC
A
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NC
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V SS (1)
I/O 12
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A 7
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NC
I/O 8
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I/O 11
NC
NC
NC
NC
NC
CE 1
CS 0
V DDQ
V DDQ
V DDQ
V DDQ
V DDQ
NC
V DDQ
V DDQ
V DDQ
V DDQ
BW 2
NC
V SS
V DD
V DD
V DD
V DD
V DD
V DD
V DD
V DD
V DD
NC
BW 1
V SS
V SS
V SS
V SS
V SS
V SS
V SS
V SS
V SS
V SS
CS 1
CLK
V SS
V SS
V SS
V SS
V SS
V SS
V SS
V SS
V SS
V SS
BWE
GW
V SS
V SS
V SS
V SS
V SS
V SS
V SS
V SS
V SS
V SS
ADSC
OE
V SS
V DD
V DD
V DD
V DD
V DD
V DD
V DD
V DD
V DD
ADV
ADSP
V DDQ
V DDQ
V DDQ
V DDQ
V DDQ
NC
V DDQ
V DDQ
V DDQ
V DDQ
A 8
A 9
NC
NC
NC
NC
NC
NC
I/O 3
I/O 2
I/O 1
I/O 0
A 10
NC (4)
I/O P1
I/O 7
I/O 6
I/O 5
I/O 4
ZZ (3)
NC
NC
NC
NC
NC
N
I/O P2
NC
V DDQ
V SS
NC/ TRST
(2,5)
(4)
NC
V SS
V DDQ
NC
NC
NC
NC/TDI
NC/TDO
P
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NC
LBO
(4)
NC (4)
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A 2
A 3
(2)
NC/TMS (2)
A 1
A 0
(2)
NC/TCK (2)
A 11
A 12
A 14
A 13
A 15
A 16
NC (4)
A 17
NOTES:
6450 tbl 17a
1. H1 does not have to be directly V SS as long as input voltage is < V IL
2. These pins are NC for the "S" version or the JTAG signal listed for the "SA" version. Note: If NC, these pins can either be tied to V SS , V DD or left floating.
3. H11 can be left unconnected and the device will always remain in active mode.
4. Pins P11, N6, B11, A1, R2 and P2 are reserved for 9M, 18M, 36M, 72M, 144M and 288M respectively.
5. TRST is offered as an optional JTAG Reset if required in the application. If not needed, can be left floating and will internally be pulled to V DD .
8
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